Description du poste:
La mission consiste à prendre en charge le design d'un ou plusieurs blocs d'un circuit de traitement video :
Les principaux objectifs du poste sont :
Participer à la définition de la micro-architecture
Rédiger les spécifications fonctionnelles de sous-ensembles du circuit
Implémenter la description RTL de ces blocs (VHDL voire SystemVerilog)
Assurer une bonne intégration au niveau top level
Suivi de la vérification fonctionnelle (Debug et correction)
Suivi et correction pour l'implémentation physique
L'agence de rattachement de cette offre se situe à Nice-sophia-antipolis.
L'agence de rattachement de cette offre se situe à Nice-sophia-antipolis.
L'agence de rattachement de cette offre se situe à Nice Sophia-Antipolis. Profil Recherché
Compétences :
Maitrise d'un langage de description RTL (Verilog ou VHDL, SystemVerilog)
Première expérience en développement d'ASIC
Connaissance en optimisation consommation power
Anglais courant (écrit et oral)
Avantages Salariaux
10 jours de RTT par an
Allocation repas ou Titre restaurant presque intégralement pris en charge
Mutuelle Santé Famille
Compte Epargne Temps
Participation et Intéressement
Prime de cooptation de 1000 ou 1500 €
Prime de vacances
Prime Transport de 200 € net par an et 50 € brut mensuel.
Qui sommes-nous
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Imaginer et concevoir les systèmes embarqués du futur :
ELSYS Design rassemble une communauté de spécialistes en systèmes embarqués passionnés par leur métier et par les nouvelles technologies.
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